有很多技術可以降低小數分頻的雜散。通常可以在分頻系數變化的時候通過增加或減少鑒相器輸出的電壓來實現。另一種方法是使用一個允許更大的分頻系數的多模分頻器。在這種情況下，我們會得到大量的小幅度雜散。多模分頻器往往和Delta-Sigma調制器一起使用，產生隨機頻率雜散并將它們推向更高的偏移頻率，使其可以通過回路濾波器過濾掉。盡管存在各種改進的技術，小數分頻技術的主要缺點是由小數劃分機制導致的相位誤差過量產生的大量雜散電平。頻率發生器輸出一般為電信號。APSYN140頻率綜合器9kHz至43.5GHz可設
一個簡單的PLL頻率綜合器表現出各種限制和權衡。對頻率綜合器性能的主要影響是由為了實現較高的頻率所需的大分頻比和較高的分辨率引起的。注意由PLL器件產生的任何噪聲以20logN的速度惡化，其中N為分頻比。工作在小步長的傳統的整數分頻鎖相環，分頻比較大是因為步長必須等于鑒相器的比較頻率。結果相位噪聲大幅惡化。此外頻率綜合器的切換速度由其環路帶寬決定，因此受限于鑒相器比較頻率。由于環路濾波器帶外抑制不足，或者甚至環路不穩定，增加環路帶寬可能會導致更高頻的參考雜散。因此，這個簡單的單環架構鎖相環受限于相互排斥的設計目標。它通常用于要求不高的應用領域或側重于低成本應用。湖南簡單易操作頻率綜合器性價比選擇鎖相環（PLL）頻率合成器時有哪些關鍵性能參數需要考慮？
相位比較器對基準信號輸入與VCO產生的信號輸入進行相位比較，輸出反映兩信號相位誤差的電壓。鑒相器多種多樣，有數字的，也有模擬的，如雙口鑒相器、鑒頻鑒相器等。在頻率合成電路中，鑒相器通常被集成在一個芯片中，這個芯片通常稱為PLL（鎖相環），或被集成在一個復合芯片中（即該芯片包含多種功能電路）。低通濾波器低通濾波器簡稱LPF（LowPassFi1ter）。低通濾波器在頻率合成環路中又稱為環路濾波器，位于鑒相器與VCO電路之間，低通濾波器通過對電路參數進行適當設置，使高頻成分被濾除。鑒相器PD的輸出不但包含直流控制信號，還有一些高頻諧波成分，這些諧波會影響VCO電路的工作。低通濾波器就是要把這些高頻成分濾除，以防止對VCO電路造成干擾。
雖然DDS工作頻點接近直流，但根據奈奎斯特原理，其比較高頻率只能到時鐘頻率的一半。雖然可以工作在高于奈奎斯特區，但是性能下降非常快。另一個嚴重的問題是由于DDS技術中固有的許多因素導致的較高雜散，例如數位截取、量化和DAC轉換誤差。DSS的形式可以是完全集成的芯片或可以使用單獨的現場可編程門陣列（FPGA）和DAC芯片來實現。后者可將數字部分限制在FPGA內部，因此隔離了EMI引起的雜散。如今FPGA有足夠的能力來建立相當復雜的多核相位累加器和索引表，由數位截取導致的雜散電平可忽略不計。結果主要的雜散源通常是由于DAC的非線性和量化噪聲引起的。頻率合成器直接用數字顯示頻率。
頻率合成器按照頻率產生機理，可以分為：直接模擬合成法、鎖相環合成法和直接數字合成法。1、直接模擬合成法利用倍頻、分頻、混頻及濾波，從單一或幾個參數頻率中產生多個所需的頻率。該方法頻率轉換時間快(小于100ns)，但是體積大、功耗大，目前已基本不被采用。2、鎖相環合成法通過鎖相環完成頻率的加、減、乘、除運算。該方法結構簡化、便于集成，且頻譜純度高，目前使用比較廣，但存在高分辨率和快轉換速度之間的矛盾，一般只能用于大步進頻率合成技術中。頻率合成器是由一個或幾個高穩定的參考頻率，產生出所需頻率的裝置。湖北1kHz頻率綜合器銷售
頻率合成器的實現方法有3種：直接模擬頻率合成、間接頻率合成和直接數字頻率合成。APSYN140頻率綜合器9kHz至43.5GHz可設
本振頻率調節范圍取決于分頻系數的變化范圍，準確地說，取決于分頻器的位數，由于位數是任意的（理論上），所以頻率調節范圍相當寬，也就是可預選的電視頻道相當多。頻率合成式高頻頭能兼容接收CATV有線增補頻道，不過，要在CPU的控制數據中增加CATV增補頻道所需的頻道數據才行。這些必須要在CPU的軟件設計中由生產廠家事先設定，一般用戶及檢修人員無法改變。頻率合成技術還廣泛應用于手機的發射電路、本振電路中，這里不再具體分析，有興趣的讀者可參考相關書籍。APSYN140頻率綜合器9kHz至43.5GHz可設
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